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인사이드 머신

원제 : Inside the Machine
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책소개

현대 컴퓨터의 실리콘 심장! 그 내부를 들여다보자

컴퓨터 프로세스가 어떻게 작동하는지, 프로세서의 문제는 어떻게 해결하는지에 대한 내용을 담은『인사이드 머신』. 이 책은 실제 프로세서들에 대한 설명과 함께 각 프로세서 계열에서 마이크로아키텍처와 ISA가 어떻게 진화했는가에 대한 내용을 소개한다.

또한 64비트 컴퓨터에 대한 개념과 컴퓨터 메모리 계층 구조와 기능, 인텔 프로세스에 대한 내용도 함께 설명한다.

출판사 서평

『인사이드 머신: 그림으로 배우는 컴퓨터 아키텍처와 마이크로프로세서』는 컴퓨터 아키텍처 부분의 명저인 (하지만 읽기는 쉽지 않은) 헤네시와 패터슨의 책과, 컴퓨터 아키텍처를 본격적으로 알고 싶어하는 사람들이 보기에는 너무 쉬운 책들 사이의 간극을 메우기 위해 쓴 책이다. 컴퓨터를 좀 사용해본 독자들은(스크립트 언어라도, 일단 프로그램을 작성해본 경험이 있는 사람이라면) 이 책을 통해 오늘날 컴퓨터 프로세서가 어떤 식으로 동작하는지 깊이 있는 지식을 얻을 수 있을 것이다. 이 책을 읽고 난 독자는 혼자 힘으로도 앞서 소개한 헤네시와 패터슨의 책을 더욱 쉽게 읽을 수 있을 것이고, 대학교 정규 수업을 받으며 좀더 체계적인 지식을 쌓을 수 있게 될 것이다.

이 책은 여러 프로세서에서 같은 문제를 어떤 방식으로 해결하는지 비교해서 설명한다. 각 장은 앞 장의 내용을 알고 있다고 가정하고 쓰여 있기 때문에 초중급 독자는 가급적 앞에서부터 순서대로 읽기를 권한다. 한편 컴퓨터 아키텍처에 이미 상당한 지식이 있는 독자라면 원하는 내용만 골라 읽어도 괜찮다. 이 책은 각 장의 내용을 상세히 나눠놓아서, 원할 경우 특정 프로세서의 기능을 쉽게 참고할 수 있게 했다.

이 책의 1장에서 4장까지는 이후 실제 프로세서들에 대한 설명을 이해하기 위한 기본 개념을 설명했다. 여기에서는 DLW라는 매우 단순한 프로세서를 예로 들어 명령어와 데이터의 개념, 어셈블리 프로그래밍, 수퍼스칼라, 파이프라인, 프로그래밍 모델, 기계어 등에 대해 설명한다.

중반부는 인텔의 펜티엄 계열 프로세서와 IBM, 모토로라의 파워PC 계열 프로세서에 대해 설명한다. 이를 통해 독자는 각 프로세서 계열에서 마이크로아키텍처와 ISA가 어떤 식으로 진화해 왔는지 알 수 있다. 이 과정에서 실제 프로세서를 예로 들어 예측 수행, 벡터 처리, 명령어 변환 등의 고급 기법들에 대해 살펴볼 것이다. 중반부 설명에서 필자가 사용한 방법은 '비교 분석법'이다. 각 프로세서의 참신한 기능을 설명할 때면, 비슷한 문제를 해결하기 위해 경쟁 제품과 이전 제품들은 어떤 기법을 사용했었는지 비교해서 설명한다. 특히 7장과 8장에서는 각기 다른 접근 기법을 사용한 인텔의 펜티엄4와 모토로라의 MPC 7450(G4e)을 상세히 비교 분석했다.

9장에서는 64비트 컴퓨터에 대한 개념을 설명하고 널리 사용되는 x86 ISA에 대한 64비트 확장을 알아본다. 이어 10장에서는 최초로 출시된 64비트 프로세서인 IBM 파워PC 970에 대해 설명한다. 파워PC 970은 이 책에서 다루는 마지막 파워PC 계열의 프로세서로, 이에 대한 설명은 IBM의 파워4 메인프레임 프로세서에도 거의 동일하게 적용된다. 11장은 오늘날 대부분 컴퓨터에서 사용되는 메모리 계층의 구조와 기능에 대해 설명한다.

마지막 장인 12장은 인텔의 최신 프로세서인 펜티엄 M, 코어 듀오, 코어 2 듀오에 대해 알아본다. 12장에서는 책으로 출판된 자료나 인터넷상에서 공개된 자료를 통틀어 이들 프로세서에 대한 가장 상세한 부분까지 설명하고 있다. 심지어 일부 정보는 이 책을 통해 처음으로 공개된다.

단언컨대 이 책은 내가 지금까지 본 것 중 가장 훌륭한 컴퓨터 아키텍처 책이다. 명료한 설명에 논리적인 구성, 최신 내용을 담고 있다. 이 분야에 관한 지식이 필요한 학생이나 직장인을 위한 필독서이다.
- 존 스트로만 / 인텔 사의 기술 매니저

이 책은 컴퓨터 아키텍처의 고전인, 하지만 읽기는 쉽지 않은 헤네시/패터슨의 저서와 엔지니어에게는 너무 기초적인 "컴퓨터는 어떻게 동작하는가" 류의 서적 사이의 간극을 메워주는 역할을 한다. 이 책은 읽기 쉬우며, 마이크로프로세서 분야에서 몇 년의 실무 경험이 있는 사람도 새로 배우는 것이 있을 정도로 교육적이다. 특히 컬러로 구성된 그림들은 정말 훌륭하다. 개인적으로 패터슨의 책을 볼 때처럼, 책을 읽기 위해 작심하고 각종 수학 지식을 복습하지 않고서도 책을 읽을 수 있었던 점을 높이 사고 싶다.
- 아마존 리뷰어 calvinnme "Texan refugee"

최신 프로세서 설계는 물론 아주 복잡하다. 하지만 저자의 설명이 훌륭해서 관련 분야 대학원 학위가 없는 사람이더라도 최신 프로세서의 설계를 잘 이해할 수 있을 것이다. 이 책을 다 읽을 때쯤이면, 2.8Ghz 프로세서가 3.2Ghz 프로세서보다 훨씬 빠를 수도 있음을 알게 될 것이다. 컬러로 된 그림들과 저자의 친절한 설명 덕분에 이 책은 '재미있게' 읽을 수 있다. 수 년간 대학에 다니지 않고서도 마이크로프로세서의 설계에 대해 배울 수 있는 길이 이 책에 모두 담겨있다.
- 아마존 리뷰어 Thomas Duff "Duffbert"

목차

1장 컴퓨터 동작의 기본 개념 1
계산기 모델 2
문서관리원 모델 3
스토어 프로그램 컴퓨터 4
문서관리원 모델 다시 보기 6
레지스터 파일 7
RAM: 레지스터만으로는 부족할 때 8
문서관리원 모델의 확장 9
예: 두 수 더하기 10
코드 스트림 살펴 보기:프로그램 10
명령어의 종류 11
DLW-1 기본 아키텍처 및 산술 명령어 포맷 12
메모리 접근 자세히 보기: 레지스터와 직접값 비교 14
직접값 14
상대 레지스터 주소 지정 16

2장 프로그램 실행의 원리 19
연산코드와 기계어 19
DLW-1의 기계어 19
산술 명령어의 바이너리 인코딩 21
메모리 접근 명령어의 바이너리 인코딩 23
예제 프로그램을 기계어로 바꾸기 25
프로그래밍 모델과 ISA 26
프로그래밍 모델 26
명령어 레지스터와 프로그램 카운터 26
명령어 페치: 명령어 레지스터 채우기 28
간단한 프로그램 실행 예제: 페치-실행 루프 28
클럭 29
분기 명령어 30
무조건 분기 30
조건 분기 30
부록: 부팅 34

3장 파이프라인 35
명령어의 생명 주기 36
명령어의 기본 흐름 38
파이프라인 40
프로세서에의 적용 43
단일 사이클 프로세서 43
파이프라인 프로세서 45
파이프라인으로 인한 속도 향상 48
프로그램 수행시간과 완료율 51
프로그램 수행시간과 완료율의 관계 52
명령어 산출량과 파이프라인 멈춤 53
명령어 지연시간과 파이프라인 멈춤 57
파이프라인의 한계 58

4장 슈퍼스칼라 수행 61
수퍼스칼라 수행과 IPC 64
수퍼스칼라의 수행 유닛 65
기본적인 숫자 포맷과 산술 연산 66
산술 논리 유닛 67
메모리 접근 유닛 69
마이크로아키텍처와 ISA 69
ISA의 역사 71
복잡한 하드웨어에서 복잡한 소프트웨어로 73
파이프라인 및 수퍼스칼라 설계에 따른 변화 74
데이터 해저드 74
구조 해저드 76
레지스터 파일 77
제어 해저드 78

5장 펜티엄 79
오리지널 펜티엄 80
캐쉬 81
펜티엄 프로세서의 파이프라인 82
분기 유닛과 분기 예측 85
펜티엄 프로세서의 백엔드 87
펜티엄의 x86 지원 91
정리: 역사적 관점에서 본 펜티엄 프로세서 92
인텔 P6 마이크로아키텍처: 펜티엄 프로 93
프론트엔드와 백엔드의 분리 94
P6 파이프라인 100
P6에서의 분기 예측 102
P6 백엔드 102
CISC, RISC 및 명령어 변환 103
P6 마이크로아키텍처의 명령어 디코드 유닛 106
P6의 x86 지원 107
정리: 역사적 관점에서 본 P6 마이크로아키텍처 107
결론 110

6장 파워PC 프로세서: 600계열, 700계열, 1400계열 111
파워PC의 역사 111
파워PC 601 112
601의 파이프라인과 프론트엔드 112
601의 백엔드 115
지연시간과 산출량 다시 보기 117
정리: 역사적 관점에서 본 601 118
파워PC 603과 603e 119
603의 백엔드 119
603e의 프론트엔드, 명령어 창, 분기 예측 122
정리: 역사적 관점에서 본 603과 603e 122
파워PC 604 123
604의 파이프라인과 백엔드 123
604의 프론트엔드와 명령어 창 126
정리: 역사적 관점에서 본 604 129
파워PC 604e 129
파워PC 750 (G3) 130
750의 프론트엔드, 명령어창, 분기 명령어 130
정리: 역사적 관점에서 본 750 132
파워PC 7400 (G4) 133
G4의 벡터 유닛 135
정리: 역사적 관점에서 본 G4 135
결론 135

7장 인텔 펜티엄 4와 모토로라 G4e 137
속도 중독 - 펜티엄 4 138
펜티엄 4와 G4e의 문제 접근 방법과 설계 철학 140
G4e 아키텍처 및 파이프라인 144
스테이지 1, 2: 명령어 페치 145
스테이지 3: 디코드/디스패치 145
스테이지 4: 이슈 146
스테이지 5: 수행 146
스테이지 6, 7: 완료 및 쓰기 147
G4e와 펜티엄 4에서의 분기 예측 147
펜티엄 4 아키텍처 148
명령어 창의 확장 149
트레이스 캐쉬 149
펜티엄 4의 파이프라인 155
스테이지 1, 2: 트레이스 캐쉬 - 포인터 155
스테이지 3, 4: 트레이스 캐쉬 - 페치 155
스테이지 5: 드라이브 155
스테이지 6~8: 할당 및 리네임(ROB) 155
스테이지 9: 큐 156
스테이지 10~12: 스케줄링 156
스테이지 13~14: 이슈 157
스테이지 15~16: 레지스터 파일 158
스테이지 17: 수행 158
스테이지 18: 플래그 158
스테이지 19: 분기 점검 158
스테이지 20: 드라이브 158
스테이지 21 이후: 완료 및 커밋 159
펜티엄 4의 명령어 창 159

8장 인텔 펜티엄 4와 모토로라 G4e: 백엔드 161
피연산자 포맷 161
정수 수행 유닛 163
G4e의 IU: 자주 발생하는 경우를 빠르게 163
펜티엄 4의 IU: 자주 발생하는 경우를 2배 빠르게 164
부동소수점 유닛 165
G4e의 FPU 166
펜티엄 4의 FPU 167
G4e와 펜티엄 4의 FPU에 대한 맺음말 168
벡터 수행 유닛 168
벡터 연산이란 168
벡터 다시 보기: 알티벡 명령어 169
알티벡 벡터 연산 170
G4e의 VU: 제대로 구현된 SIMD 173
인텔 MMX 174
SSE와 SSE2 175
펜티엄 4의 벡터 유닛 176
SSE2를 사용한 부동소수점 성능 향상 177
결론 177

9장 64비트 컴퓨터와 x86-64 179
인텔 IA-64와 AMD x86-64 179
왜 64비트인가? 181
64비트 컴퓨터란? 181
64비트의 활용 영역 183
표현 영역 183
표현 범위 증가로 인한 이득 184
가상 주소 공간과 물리 주소 공간 185
64비트 주소의 이점 186
64비트로 된 대안: x86-64 187
레지스터의 확장 187
레지스터 수의 증가 187
모드 변환 189
오래된 기능의 퇴출 192
결론 192

10장 G5: IBM 파워PC 970 193
설계 철학 194
캐쉬와 프론트엔드 194
분기 예측 195
트레이드오프: 디코드, 크랙, 그룹 196
970의 디스패치 규칙 198
프리디코드와 그룹 디스패치 199
970의 그룹 디스패치 기법에 대한 결론 199
파워PC 970의 백엔드 200
정수 유닛, 조건 레지스터 유닛, 분기 유닛 200
동일하지 않은 정수 유닛 201
정수 유닛 지연시간 및 산출량 202
CRU 202
970의 정수 성능에 대한 결론 203
로드 스토어 유닛 203
프론트 사이드 버스 204
부동소수점 유닛 205
파워PC 970에서의 벡터 처리 206
부동소수점 이슈 큐 209
정수 및 로드 스토어 이슈 큐 210
BU 및 CRU 이슈 큐 210
벡터 이슈 큐 211
970 그룹 디스패치 기법의 성능 211
결론 213

11장 캐쉬와 시스템 성능 215
캐쉬의 기초 215
1차 캐쉬 217
2차 캐쉬 218
예: 메모리 계층 내에서의 데이터 이동 219
캐쉬 미스 220
데이터/코드의 집약성 220
데이터의 공간 집약성 221
코드의 공간 집약성 221
코드와 데이터의 시간 집약성 223
집약성: 결론 224
캐쉬의 구조: 블록과 블록 프레임 225
태그 RAM 226
완전 연관 매핑 226
집적 매핑 227
N웨이 집합 연관 매핑 229
4웨이 집합 연관 매핑 229
2웨이 집합 연관 매핑 231
2웨이 집합 연관 매핑과 직접 매핑 231
2웨이 집합 연관 매핑과 4웨이 집합 연관 매핑 232
캐쉬의 집합 연관성: 결론 232
시간/공간/집약성과 캐쉬의 교체 정책 및 블록 크기와의 관계 233
고체/방출 정책의 종류 233
블록의 크기 234
쓰기 정책 라이트 스루와 라이트백 235
결론 236

12장 인텔 펜티엄 M, 코어 듀오, 코어 2 듀오 232
코드명과 브랜드명 235
전력 효율성을 중시한 컴퓨터의 등장 238
전력 밀도 239
동적 전력 밀도 239
정적 전력 밀도 240
펜티엄 M 241
페치 단계 241
디코드 단계: 마이크로옵 퓨전 242
분기 예측 246
스택 수행 유닛 248
파이프라인과 백엔드 248
정리: 역사적 관점에서 본 펜티엄 M 프로세서 248
코어 듀오/솔로 249
인텔이 설계한 멀티코어 프로세서 249
코어 듀오의 기능 향상 253
정리:역사적 관점에서 본 코어 듀오 256
코어 2 듀오 256
페치 단계 258
디코드 단계 259
코어의 파이프라인 260
코어의 백엔드 260
향상된 벡터 처리 264
메모리 명확화: 예측 수행의 결과 스트림 버전 266
요약: 역사적 관점에서 본 코어 2듀오 272

참고 문헌 271

저자소개

존 스토크스 [저] 신작알림 SMS신청
생년월일 1975

존 '한니발' 스토크스는 아르스 테크니카의 공동 설립자이자 수석 CPU 편집자이다. 마이크로프로세서 아키텍처와 개인용 컴퓨터에 대한 다양한 글을 써온 스토크스는 루이지애나 주립 대학에서 컴퓨터 공학 학사학위를 받았으며 하버드 대학 인문대에서 2개의 석사 학위를 받았다. 지금은 시카고 대학에서 박사 과정을 밟고 있다.

전동환, 안익진 [역] 신작알림 SMS신청
생년월일 -

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